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C
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C
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/* SPDX-License-Identifier: GPL-2.0-only */
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/*
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* Copyright (c) 2022 MediaTek Inc.
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* Author: Ping-Hsun Wu <ping-hsun.wu@mediatek.com>
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*/
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#ifndef __MDP_REG_WROT_H__
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#define __MDP_REG_WROT_H__
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#define VIDO_CTRL 0x000
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#define VIDO_MAIN_BUF_SIZE 0x008
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#define VIDO_SOFT_RST 0x010
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#define VIDO_SOFT_RST_STAT 0x014
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#define VIDO_CROP_OFST 0x020
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#define VIDO_TAR_SIZE 0x024
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#define VIDO_OFST_ADDR 0x02c
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#define VIDO_STRIDE 0x030
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#define VIDO_OFST_ADDR_C 0x038
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#define VIDO_STRIDE_C 0x03c
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#define VIDO_DITHER 0x054
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#define VIDO_STRIDE_V 0x06c
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#define VIDO_OFST_ADDR_V 0x068
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#define VIDO_RSV_1 0x070
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#define VIDO_IN_SIZE 0x078
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#define VIDO_ROT_EN 0x07c
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#define VIDO_FIFO_TEST 0x080
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#define VIDO_MAT_CTRL 0x084
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#define VIDO_BASE_ADDR 0xf00
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#define VIDO_BASE_ADDR_C 0xf04
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#define VIDO_BASE_ADDR_V 0xf08
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/* MASK */
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#define VIDO_CTRL_MASK 0xf530711f
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#define VIDO_MAIN_BUF_SIZE_MASK 0x1fff7f77
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||
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#define VIDO_SOFT_RST_MASK 0x00000001
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||
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#define VIDO_SOFT_RST_STAT_MASK 0x00000001
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||
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#define VIDO_TAR_SIZE_MASK 0x1fff1fff
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#define VIDO_CROP_OFST_MASK 0x1fff1fff
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#define VIDO_OFST_ADDR_MASK 0x0fffffff
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#define VIDO_STRIDE_MASK 0x0000ffff
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#define VIDO_OFST_ADDR_C_MASK 0x0fffffff
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#define VIDO_STRIDE_C_MASK 0x0000ffff
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#define VIDO_DITHER_MASK 0xff000001
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#define VIDO_STRIDE_V_MASK 0x0000ffff
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#define VIDO_OFST_ADDR_V_MASK 0x0fffffff
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#define VIDO_RSV_1_MASK 0xffffffff
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#define VIDO_IN_SIZE_MASK 0x1fff1fff
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#define VIDO_ROT_EN_MASK 0x00000001
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#define VIDO_FIFO_TEST_MASK 0x00000fff
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#define VIDO_MAT_CTRL_MASK 0x000000f3
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#define VIDO_BASE_ADDR_MASK 0xffffffff
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#define VIDO_BASE_ADDR_C_MASK 0xffffffff
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#define VIDO_BASE_ADDR_V_MASK 0xffffffff
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#endif // __MDP_REG_WROT_H__
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