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// SPDX-License-Identifier: GPL-2.0
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#include "tegra30-asus-nexus7-grouper-common.dtsi"
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#include "tegra30-asus-nexus7-grouper-memory-timings.dtsi"
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/ {
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compatible = "asus,grouper", "nvidia,tegra30";
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pinmux@70000868 {
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state_default: pinmux {
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lcd_dc1_pd2 {
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nvidia,pins = "lcd_dc1_pd2";
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||
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|
nvidia,function = "displaya";
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||
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|
nvidia,pull = <TEGRA_PIN_PULL_NONE>;
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||
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|
nvidia,tristate = <TEGRA_PIN_DISABLE>;
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||
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|
nvidia,enable-input = <TEGRA_PIN_ENABLE>;
|
||
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|
};
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||
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lcd_pwr2_pc6 {
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||
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|
nvidia,pins = "lcd_pwr2_pc6";
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||
|
|
nvidia,function = "displaya";
|
||
|
|
nvidia,pull = <TEGRA_PIN_PULL_NONE>;
|
||
|
|
nvidia,tristate = <TEGRA_PIN_DISABLE>;
|
||
|
|
nvidia,enable-input = <TEGRA_PIN_DISABLE>;
|
||
|
|
};
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||
|
|
spi2_cs2_n_pw3 {
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||
|
|
nvidia,pins = "spi2_cs2_n_pw3";
|
||
|
|
nvidia,function = "spi2";
|
||
|
|
nvidia,pull = <TEGRA_PIN_PULL_NONE>;
|
||
|
|
nvidia,tristate = <TEGRA_PIN_DISABLE>;
|
||
|
|
nvidia,enable-input = <TEGRA_PIN_ENABLE>;
|
||
|
|
};
|
||
|
|
spi1_sck_px5 {
|
||
|
|
nvidia,pins = "spi1_sck_px5";
|
||
|
|
nvidia,function = "spi1";
|
||
|
|
nvidia,pull = <TEGRA_PIN_PULL_NONE>;
|
||
|
|
nvidia,tristate = <TEGRA_PIN_DISABLE>;
|
||
|
|
nvidia,enable-input = <TEGRA_PIN_ENABLE>;
|
||
|
|
};
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||
|
|
pu5 {
|
||
|
|
nvidia,pins = "pu5";
|
||
|
|
nvidia,function = "pwm2";
|
||
|
|
nvidia,pull = <TEGRA_PIN_PULL_NONE>;
|
||
|
|
nvidia,tristate = <TEGRA_PIN_DISABLE>;
|
||
|
|
nvidia,enable-input = <TEGRA_PIN_ENABLE>;
|
||
|
|
};
|
||
|
|
spi1_miso_px7 {
|
||
|
|
nvidia,pins = "spi1_miso_px7";
|
||
|
|
nvidia,function = "spi1";
|
||
|
|
nvidia,pull = <TEGRA_PIN_PULL_NONE>;
|
||
|
|
nvidia,tristate = <TEGRA_PIN_DISABLE>;
|
||
|
|
nvidia,enable-input = <TEGRA_PIN_ENABLE>;
|
||
|
|
};
|
||
|
|
spi2_mosi_px0 {
|
||
|
|
nvidia,pins = "spi2_mosi_px0";
|
||
|
|
nvidia,function = "spi2";
|
||
|
|
nvidia,pull = <TEGRA_PIN_PULL_NONE>;
|
||
|
|
nvidia,tristate = <TEGRA_PIN_DISABLE>;
|
||
|
|
nvidia,enable-input = <TEGRA_PIN_ENABLE>;
|
||
|
|
};
|
||
|
|
kb_row7_pr7 {
|
||
|
|
nvidia,pins = "kb_row7_pr7";
|
||
|
|
nvidia,function = "kbc";
|
||
|
|
nvidia,pull = <TEGRA_PIN_PULL_NONE>;
|
||
|
|
nvidia,tristate = <TEGRA_PIN_DISABLE>;
|
||
|
|
nvidia,enable-input = <TEGRA_PIN_DISABLE>;
|
||
|
|
};
|
||
|
|
pu3 {
|
||
|
|
nvidia,pins = "pu3";
|
||
|
|
nvidia,function = "rsvd4";
|
||
|
|
nvidia,pull = <TEGRA_PIN_PULL_NONE>;
|
||
|
|
nvidia,tristate = <TEGRA_PIN_DISABLE>;
|
||
|
|
nvidia,enable-input = <TEGRA_PIN_ENABLE>;
|
||
|
|
};
|
||
|
|
pu4 {
|
||
|
|
nvidia,pins = "pu4";
|
||
|
|
nvidia,function = "pwm1";
|
||
|
|
nvidia,pull = <TEGRA_PIN_PULL_NONE>;
|
||
|
|
nvidia,tristate = <TEGRA_PIN_ENABLE>;
|
||
|
|
nvidia,enable-input = <TEGRA_PIN_ENABLE>;
|
||
|
|
};
|
||
|
|
kb_row15_ps7 {
|
||
|
|
nvidia,pins = "kb_row15_ps7";
|
||
|
|
nvidia,function = "kbc";
|
||
|
|
nvidia,pull = <TEGRA_PIN_PULL_NONE>;
|
||
|
|
nvidia,tristate = <TEGRA_PIN_DISABLE>;
|
||
|
|
nvidia,enable-input = <TEGRA_PIN_DISABLE>;
|
||
|
|
};
|
||
|
|
kb_row3_pr3 {
|
||
|
|
nvidia,pins = "kb_row3_pr3";
|
||
|
|
nvidia,function = "kbc";
|
||
|
|
nvidia,pull = <TEGRA_PIN_PULL_NONE>;
|
||
|
|
nvidia,tristate = <TEGRA_PIN_DISABLE>;
|
||
|
|
nvidia,enable-input = <TEGRA_PIN_DISABLE>;
|
||
|
|
};
|
||
|
|
kb_row13_ps5 {
|
||
|
|
nvidia,pins = "kb_row13_ps5";
|
||
|
|
nvidia,function = "kbc";
|
||
|
|
nvidia,pull = <TEGRA_PIN_PULL_NONE>;
|
||
|
|
nvidia,tristate = <TEGRA_PIN_ENABLE>;
|
||
|
|
nvidia,enable-input = <TEGRA_PIN_DISABLE>;
|
||
|
|
};
|
||
|
|
gmi_wp_n_pc7 {
|
||
|
|
nvidia,pins = "gmi_wp_n_pc7",
|
||
|
|
"gmi_wait_pi7",
|
||
|
|
"gmi_cs4_n_pk2",
|
||
|
|
"gmi_cs3_n_pk4";
|
||
|
|
nvidia,function = "rsvd1";
|
||
|
|
nvidia,pull = <TEGRA_PIN_PULL_NONE>;
|
||
|
|
nvidia,tristate = <TEGRA_PIN_ENABLE>;
|
||
|
|
nvidia,enable-input = <TEGRA_PIN_DISABLE>;
|
||
|
|
};
|
||
|
|
gmi_cs6_n_pi3 {
|
||
|
|
nvidia,pins = "gmi_cs6_n_pi3";
|
||
|
|
nvidia,function = "gmi";
|
||
|
|
nvidia,pull = <TEGRA_PIN_PULL_NONE>;
|
||
|
|
nvidia,tristate = <TEGRA_PIN_ENABLE>;
|
||
|
|
nvidia,enable-input = <TEGRA_PIN_DISABLE>;
|
||
|
|
};
|
||
|
|
};
|
||
|
|
};
|
||
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|
i2c@7000c500 {
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|
nfc@28 {
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|
compatible = "nxp,pn544-i2c";
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|
reg = <0x28>;
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||
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|
interrupt-parent = <&gpio>;
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|
interrupts = <TEGRA_GPIO(X, 0) IRQ_TYPE_EDGE_RISING>;
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||
|
|
enable-gpios = <&gpio TEGRA_GPIO(S, 7) GPIO_ACTIVE_HIGH>;
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||
|
|
firmware-gpios = <&gpio TEGRA_GPIO(R, 3) GPIO_ACTIVE_HIGH>;
|
||
|
|
};
|
||
|
|
};
|
||
|
|
|
||
|
|
display-panel {
|
||
|
|
panel-timing {
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||
|
|
clock-frequency = <68000000>;
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||
|
|
hactive = <800>;
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|
|
vactive = <1280>;
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|
|
hfront-porch = <24>;
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||
|
|
hback-porch = <32>;
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|
|
hsync-len = <24>;
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||
|
|
vsync-len = <1>;
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|
|
vfront-porch = <5>;
|
||
|
|
vback-porch = <32>;
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};
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|
};
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|
};
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